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- cj620976 2011-04-12 00:00:00
- http://cdmd.cnki.com.cn/Article/CDMD-10295-2009250206.htm
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熱門問答
- 誰會做基于FPGA的DDS調(diào)頻信號發(fā)生器的VHDL程序
2011-04-11 02:53:50
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- DDS信號發(fā)生器與DDS調(diào)頻信號發(fā)生器有何區(qū)別？？
2011-12-07 14:03:53
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- 基于FPGA的高精度DDS頻率計的設計
- 課題要求是 基于FPGA設計輸出100KHz到1MHz +/- 1KHz的正弦波頻率， 1KHz步進，并用數(shù)模轉換器差分電路等得到穩(wěn)定的正弦波輸出。 （1） FPGA可采用CYCLONE。（2） 熟悉Verilog 和VHDL （3） 可通過數(shù)碼管或LCD顯示相關頻率數(shù)據(jù)。 求各路大神指點迷津 有消息請... 課題要求是 基于FPGA設計輸出100KHz到1MHz +/- 1KHz的正弦波頻率， 1KHz步進，并用數(shù)模轉換器差分電路等得到穩(wěn)定的正弦波輸出。 （1） FPGA可采用CYCLONE。（2） 熟悉Verilog 和VHDL （3） 可通過數(shù)碼管或LCD顯示相關頻率數(shù)據(jù)。 求各路大神指點迷津 有消息請聯(lián)系我詳談 重謝！ 展開
2015-04-22 13:25:59
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- 求基于FPGA的信號發(fā)生器 畢業(yè)設計
- 設計一種基于FPGA的新型可調(diào)信號發(fā)生器，要求通過QuartusII軟件及VHDL編程語言設計定制數(shù)據(jù)ROM，并通過地址指針讀取ROM中不同區(qū)域的數(shù)據(jù)，根據(jù)讀取數(shù)據(jù)間隔的不同，實現(xiàn)調(diào)整頻率功能。... 設計一種基于FPGA的新型可調(diào)信號發(fā)生器，要求通過QuartusII軟件及VHDL編程語言設計定制數(shù)據(jù)ROM，并通過地址指針讀取ROM中不同區(qū)域的數(shù)據(jù)，根據(jù)讀取數(shù)據(jù)間隔的不同，實現(xiàn)調(diào)整頻率功能。設計要求可產(chǎn)生正弦波、方波、三角波和鋸齒波4種波形信號。郵箱：564710692@qq.com 多謝~ 展開
2012-04-07 19:14:23
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- 基于fpga的信號發(fā)生器設計怎么做
2018-11-22 01:25:10
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- 基于dds的信號發(fā)生器和基于單片機的信號發(fā)生器相比有什么優(yōu)勢？
- 在設計的電路中各個參數(shù)都是根據(jù)什么確定的... 在設計的電路中各個參數(shù)都是根據(jù)什么確定的 展開
2013-06-08 15:26:52
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- 基于單片機的DDS信號發(fā)生器，誰有做好的，求助！
2018-11-30 04:07:44
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- 基于VHDL的數(shù)字頻率計
2011-08-13 05:50:24
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- 你那有基于fpga的信號發(fā)生器的資料么？
2012-05-24 06:14:06
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- 基于DDS的多路信號相位差可調(diào)的信號發(fā)生器的設計
- 這是我畢業(yè)設計的題目哪位高手幫忙提供一些資料急需?。。?！... 這是我 畢業(yè)設計的題目 哪位高手幫忙提供一些資料 急需?。。?！ 展開
2010-05-02 18:24:35
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- DDS信號發(fā)生器
- DDS信號發(fā)生器DDS信號發(fā)生器，是干什么用，用在什么設備上，DDS信號發(fā)生器，編程什么意思... DDS信號發(fā)生器DDS信號發(fā)生器，是干什么用，用在什么設備上，DDS信號發(fā)生器，編程什么意思 展開
2016-06-14 00:05:31
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- DDS(信號發(fā)生器)
- 方案一：采用芯片AD9850方案二:采用FPGA的方法來實現(xiàn)該電路所包含的模塊:輸入，顯示，D/A轉換，LPF.參數(shù)：1，分辨率2，頻率范圍20-1KHz（步進可調(diào)）3，幅度（步進可調(diào)）求：相關資料和原... 方案一：采用芯片AD9850 方案二:采用FPGA的方法來實現(xiàn) 該電路所包含的模塊:輸入，顯示，D/A轉換，LPF. 參數(shù)：1，分辨率 2，頻率范圍20-1KHz（步進可調(diào)）3，幅度（步進可調(diào)） 求：相關資料和原理圖........ 郵箱：fengyun1513@yahoo.com.cn 展開
2009-07-19 08:49:59
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- 基于FPGA的函數(shù)信號發(fā)生器如何設置引腳？謝謝
2012-10-28 02:14:03
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- 做個DDS信號發(fā)生器用altera公司的什么FPGA芯片?為什么？謝謝
2012-05-13 01:17:58
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- 基于FPGA的數(shù)字頻率計
- 不要子模塊，，要一個完整的代碼，不用調(diào)用，直接可以編譯的。。拜托了。。。。是用的VHDL語言。。
2016-02-12 15:47:21
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- EDA的調(diào)頻信號發(fā)生器的程序及課程設計報告，要求如下：
- 要求：能將FPGA內(nèi)部產(chǎn)生的低頻信號進行調(diào)制，也能選擇外部輸入的幅度小于4V的低頻模擬信號進行調(diào)制，輸出信號的載波頻率為100KHz。輸出波形峰-峰值大于2V。... 要求：能將FPGA內(nèi)部產(chǎn)生的低頻信號進行調(diào)制，也能選擇外部輸入的幅度小于4V的低頻模擬信號進行調(diào)制，輸出信號的載波頻率為100KHz。輸出波形峰-峰值大于2V。 展開
2011-06-20 23:15:22
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- 哪位學長給點基于FPGA做信號發(fā)生器的資料啊
- 做畢設用的。有的話發(fā)郵箱：songpengpeng1987@sina.com謝謝啦... 做畢設用的。有的話發(fā)郵箱：songpengpeng1987@sina.com 謝謝啦 展開
2009-04-10 21:32:04
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- fpga設計的等精度頻率計如何測出dds信號發(fā)生器產(chǎn)生的正弦信號的頻率？
- 將正弦信號經(jīng)ad轉換后送入fpga板子，然后該怎么處理？
2011-08-24 15:01:16
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- 求基于單片機的低頻信號發(fā)生器的原理圖和程序
- 需要的是4*4鍵盤DAC0832濾波電路放大電路AT89C51液晶顯示... 需要的是4*4鍵盤 DAC0832 濾波電路 放大電路 AT89C51 液晶顯示 展開
2015-04-15 00:58:46
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- VHDL序列信號發(fā)生器問題
- 編好的程序如下：LIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;ENTITYMY_100110ISPORT(CLK:INSTD_LOGIC;Z:OUTSTD_LOGIC);ENDMY_100110;ARCHITECTURERTLOFMY_100110ISTYPESTATE_TYPEIS(S0，... 編好的程序如下： LIBRARY IEEE; USE IEEE.STD_LOGIC_1164.ALL; ENTITY MY_100110 IS PORT( CLK:INSTD_LOGIC; Z :OUTSTD_LOGIC ); END MY_100110; ARCHITECTURE RTL OF MY_100110 IS TYPE STATE_TYPE IS(S0，S1，S2，S3，S4，S5); SIGNAL CURRENT_STATE，NEXT_STATE:STATE_TYPE; BEGIN SYNCH: PRECESS BEGIN WAIT UNTIL CLK'EVENT AND CLK='1'; CURRENT_STATE<=NEXT_STATE; END PROCESS; STATE_TRANS:PROCESS(CURRENT_STATE) BEGIN CASE CURRENT_STATE IS WHEN S0=> NEXT_STATE<=S1; Z<='1'; WHEN S1=> NEXT_STATE<=S2; Z<='0'; WHEN S2=> NEXT_STATE<=S3; Z<='0'; WHEN S3=> NEXT_STATE<=S4; Z<='1'; WHEN S4=> NEXT_STATE<=S5; Z<='1'; WHEN S5=> NEXT_STATE<=S0; Z<='0'; END CASE; END PROCESS; END RTL; 用quartusⅡ運行有5個錯誤，限于水平有限，求大神幫助修改！ 展開
2011-10-04 07:33:37
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