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問答社區(qū)

用verilog編寫的數(shù)字頻率計(jì)在低頻時(shí)誤差很大是什么原因。。請教。。。

王松民商法 2011-07-25 12:00:10 439  瀏覽
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參與評論

全部評論(3條)

  • 湯滿云77 2011-07-27 00:00:00
    你說的低頻有多低?1Hz還是多少?頻率低的時(shí)候可以采用記周期的方法來測撒。

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  • carsonhr 2011-07-26 00:00:00
    有干擾輸入 FPGA速率快,所以可以捕捉到很小的波形 你可以考慮在低頻的時(shí)候讓FPGA工作慢一點(diǎn)

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  • wszaizhj 2011-07-27 00:00:00
    高頻誤差小,低頻誤差大,主要問題集中在以下2點(diǎn) 1。周期數(shù)計(jì)算是否正確 2。晶振是否準(zhǔn)確,建議用示波器測量一下

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