Verilog 83優(yōu)先編碼器
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這個(gè)是83優(yōu)先編碼器 書上寫的程序 module code8_3(I,Y); input[7:0]I; output[2:0]Y; function[2:0]code; input[7:0]I; if(I[7]) code=3'b111; else if(I[6]) code=3'b110; else if(I[5]) code=3'... 這個(gè)是83優(yōu)先編碼器 書上寫的程序 module code8_3(I,Y); input[7:0]I; output[2:0]Y; function[2:0]code; input[7:0]I; if(I[7]) code=3'b111; else if(I[6]) code=3'b110; else if(I[5]) code=3'b101; else if(I[4]) code=3'b100; else if(I[3]) code=3'b011; else if(I[2]) code=3'b010; else if(I[1]) code=3'b001; else code=3'b000; endfunction assign Y=code(I); endmodule 為什么不能這么寫: module code8_3(I,Y); input[7:0]I; output[2:0]Y; reg[2:0]Y always @ (I) begin if(I[7]) Y=3'b111; else if(I[6]) Y=3'b110; else if(I[5]) Y=3'b101; else if(I[4]) Y=3'b100; else if(I[3]) Y=3'b011; else if(I[2]) Y=3'b010; else if(I[1]) Y=3'b001; else Y=3'b000; end endmodule 麻煩高手指教一下吧!另外assign A={B,C}是代表什么意思???多謝多謝!! 展開
全部評(píng)論(1條)
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- 初心暖哭i 2017-09-26 12:06:39
- 先回答你第二個(gè)問題 assign A={B,C} 代表 A = B+C 的組合位寬的值 例如: wire [1:0]A ; wire B,C; A={B,C}; //A 是2位寬的, B是1位寬的, C是1位寬的,這樣 A[1] 就對(duì)應(yīng) B ,A[0] 就對(duì)應(yīng)C. //如果 A={C,B}; //哪么 這樣 A[1] 就對(duì)應(yīng) C ,A[0] 就對(duì)應(yīng)B. 再回答你diyi個(gè)問題 可以用你的方法寫(即用always)。但是你寫的程序有個(gè)地方有錯(cuò),改一下就可以了。書上用的是function ,而你用的是always。這兩種方法比較如下: 1,如果在本模塊內(nèi),你需要實(shí)現(xiàn)2個(gè)83優(yōu)先編碼器,哪么就可以直接調(diào)用 function 模塊就行了,這樣使程序更簡(jiǎn)潔。 2,如果在本模塊內(nèi)只需要實(shí)現(xiàn)一個(gè)83優(yōu)先編碼器,就可以用 always ,在需要的地方直接調(diào)用該模塊。更利于綜合。 //修改后代碼如下 module code8_3(I,Y); input[7:0]I; output[2:0]Y; reg[2:0]Y always @ (I or Y) //這里必須包括所有的下面要用到的信號(hào)名稱 你原來是(I).少了一個(gè)Y .(也可以用*號(hào)代替 I 和 Y). begin if(I[7]) Y=3'b111; else if(I[6]) Y=3'b110; else if(I[5]) Y=3'b101; else if(I[4]) Y=3'b100; else if(I[3]) Y=3'b011; else if(I[2]) Y=3'b010; else if(I[1]) Y=3'b001; else Y=3'b000; end endmodule
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