電子信息工程本科畢業(yè)論文
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求一篇電子的畢業(yè)論文。 題目：基于CPLD的自動(dòng)換檔頻率計(jì)設(shè)計(jì) 要求：本課題的任務(wù)是利用EDA技術(shù)實(shí)現(xiàn)一個(gè)自動(dòng)換檔頻率計(jì)。在QuartusII開發(fā)軟件下編寫語言實(shí)現(xiàn)。要求在熟悉Protel軟件的使用的基礎(chǔ)上，用一片CPLD和其它輔助器件構(gòu)成一個(gè)自動(dòng)換檔頻率計(jì)。 ... 求一篇電子的畢業(yè)論文。 題目：基于CPLD的自動(dòng)換檔頻率計(jì)設(shè)計(jì) 要求：本課題的任務(wù)是利用EDA技術(shù)實(shí)現(xiàn)一個(gè)自動(dòng)換檔頻率計(jì)。在QuartusII開發(fā)軟件下編寫語言實(shí)現(xiàn)。要求在熟悉Protel軟件的使用的基礎(chǔ)上，用一片CPLD和其它輔助器件構(gòu)成一個(gè)自動(dòng)換檔頻率計(jì)。 該頻率計(jì)能實(shí)現(xiàn)由一個(gè)4位十進(jìn)制數(shù)碼管（含小數(shù)點(diǎn)）顯示結(jié)果，其測(cè)量范圍為1Hz~9999KHz，能自動(dòng)根據(jù)7位十進(jìn)制的結(jié)果，自動(dòng)選擇有效數(shù)據(jù)的高4位進(jìn)行動(dòng)態(tài)顯示（即量程自動(dòng)轉(zhuǎn)換），小數(shù)點(diǎn)表示是千位，即KHZ。要求學(xué)生畫出狀態(tài)轉(zhuǎn)移圖、編寫VHDL或VerilogHDL代碼、做出仿真波形圖。 字?jǐn)?shù)：8000字（也不一定要這么多，主要是程序要對(duì)，仿真要能成功。字?jǐn)?shù)我可以自己湊） 時(shí)間：5月29日（含）以前 展開
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- liguozheng2006 2009-05-20 00:00:00
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- 電子信息工程本科畢業(yè)論文
- 求一篇電子的畢業(yè)論文。 題目：基于CPLD的自動(dòng)換檔頻率計(jì)設(shè)計(jì) 要求：本課題的任務(wù)是利用EDA技術(shù)實(shí)現(xiàn)一個(gè)自動(dòng)換檔頻率計(jì)。在QuartusII開發(fā)軟件下編寫語言實(shí)現(xiàn)。要求在熟悉Protel軟件的使用的基礎(chǔ)上，用一片CPLD和其它輔助器件構(gòu)成一個(gè)自動(dòng)換檔頻率計(jì)。 ... 求一篇電子的畢業(yè)論文。 題目：基于CPLD的自動(dòng)換檔頻率計(jì)設(shè)計(jì) 要求：本課題的任務(wù)是利用EDA技術(shù)實(shí)現(xiàn)一個(gè)自動(dòng)換檔頻率計(jì)。在QuartusII開發(fā)軟件下編寫語言實(shí)現(xiàn)。要求在熟悉Protel軟件的使用的基礎(chǔ)上，用一片CPLD和其它輔助器件構(gòu)成一個(gè)自動(dòng)換檔頻率計(jì)。 該頻率計(jì)能實(shí)現(xiàn)由一個(gè)4位十進(jìn)制數(shù)碼管（含小數(shù)點(diǎn)）顯示結(jié)果，其測(cè)量范圍為1Hz~9999KHz，能自動(dòng)根據(jù)7位十進(jìn)制的結(jié)果，自動(dòng)選擇有效數(shù)據(jù)的高4位進(jìn)行動(dòng)態(tài)顯示（即量程自動(dòng)轉(zhuǎn)換），小數(shù)點(diǎn)表示是千位，即KHZ。要求學(xué)生畫出狀態(tài)轉(zhuǎn)移圖、編寫VHDL或VerilogHDL代碼、做出仿真波形圖。 字?jǐn)?shù)：8000字（也不一定要這么多，主要是程序要對(duì)，仿真要能成功。字?jǐn)?shù)我可以自己湊） 時(shí)間：5月29日（含）以前 展開
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